Ingeniero Rtl Asic – Diseña Socs Con Verilog/Systemverilog (Madrid)

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24 oct
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Cipherbit-Grupo Oesía
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Madrid

24 oct

Cipherbit-Grupo Oesía

Madrid

Diseño, desarrollo e integración de soluciones tecnológicas ASIC y SoC. Experiencia en Verilog/SystemVerilog, ARM/RISC-V, UVM y herramientas EDA.

📌 Ingeniero Rtl Asic – Diseña Socs Con Verilog/Systemverilog (Madrid)
🏢 Cipherbit-Grupo Oesía
📍 Madrid

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