Grupo Oesía busca un/a Ingeniero/a de diseño para test (DFT) para diseñar, desarrollar e integrar soluciones de DFT en proyectos con ASICs y SoCs en Madrid. Se requiere experiencia mínima de 3 años y conocimientos en scan insertion, ATPG, MBIST/LBIST, así como manejo de Cadence y Synopsys. Ofrecemos crecimiento profesional y entorno tecnológico para avanzar en proyectos de alta complejidad.
📌 Ingeniero/a DFT para ASIC/SoC: Test de Alto Valor (Madrid)
🏢 Cipherbit-Grupo Oesía
📍 Madrid
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