Strong collaboration with verification and analog teams is essential for silicon conversion.
The role requires deep FPGA development knowledge, Verilog/SystemVerilog RTL skills, and experience with AHB/AXI protocols
#J-18808-Ljbffr
📌 Senior FPGA & Digital Design Engineer (RTL-to-Silicon) (Valencia)
🏢 Analog Devices
📍 Valencia
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