ppEn BETWEEN te ofrecemos las oportunidades que necesitas para alcanzar tus objetivos profesionales. Si Quieres desarrollar tus capacidades en IT e Ingeniería, éste es tu próximo destino! /p pDamos soporte en una gran variedad de áreas como Firmware, Software, BI, Diseño, Project Management y muchas más. Además, desarrollamos soluciones tecnológicas a medida desde nuestros BETWEEN Labs. #LI-DNI /p p¿Te apasiona el desarrollo FPGA y buscas un proyecto donde la electrónica, la robótica y la innovación tecnológica se unan para crear sistemas únicos? /p pBuscamos un perfil con experiencia en desarrollo bFPGA/RTL /b, participando en el ciclo completo de desarrollo mediante bVHDL, Verilog o SystemVerilog /b, incluyendo simulación, síntesis, implementación (Place Route), análisis temporal (Timing Closure), validación hardware e integración de sistemas. /p h3¿Cuál será tu misión? /h3 pParticiparás en el desarrollo bend-to-end de soluciones FPGA/RTL /b para sistemas espaciales de alta complejidad, colaborando con equipos de hardware, software y mecánica. Trabajarás en todas las fases del ciclo de desarrollo: bdefinición de arquitectura, diseño RTL, simulación, síntesis, place route, timing closure, generación de bitstreams,



validación hardware e integración de sistemas /b. /p h3Tu día a día incluirá: /h3 ul liDefinición de requisitos y especificaciones detalladas de FPGA. /li liDiseño y definición de arquitecturas FPGA. /li liDesarrollo y codificación siguiendo buenas prácticas y reglas de diseño. /li liVerificación funcional mediante simulaciones y testbenches. /li liValidación y pruebas sobre hardware real. /li liAnálisis y revisión de cobertura de código. /li liSíntesis, implementación y generación de bitstreams. /li liProcesos de place route. /li liAutomatización de procesos mediante scripting. /li liElaboración de documentación técnica. /liliParticipación en revisiones técnicas con cliente y liderazgo técnico de soluciones FPGA. /li /ul pEstas son algunas de las tecnologías y herramientas presentes en el día a día del equipo: /p ul liFPGA /li liRTL Design /li liVHDL / Verilog / SystemVerilog /li liAMD/Xilinx · Microchip · Intel FPGA /li liVivado · Libero · Quartus /li liModelSim / QuestaSim /li liTiming Closure /li liPlace Route /li liHardware Validation /li liEmbedded Linux /li liSoC /li liPython / TCL /li liGit /li /ul /p #J-18808-Ljbffr

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